FBNoC: FBGA BASED NETWORK ON CHIP SIMULATOR

FBNoC: FBGA BASED NETWORK ON CHIP SIMULATOR

محفوظ في:

التفاصيل البيبلوغرافية
المؤلف الرئيسي:	unknown (author)
التنسيق:	masterThesis
منشور في:	2020
الموضوعات:	Computer
الوصول للمادة أونلاين:	https://eprints.kfupm.edu.sa/id/eprint/140363/1/Thesis_Last_version.pdf
الوسوم:	إضافة وسم لا توجد وسوم, كن أول من يضع وسما على هذه التسجيلة!

مواد مشابهة

Hardware Trojan Mitigation Technique in Network-on-Chip (NoC)
حسب: Musharraf Hussain (17541498)
منشور في: (2023)

Efficient techniques for testing networks on chips. (c2010)
حسب: Abou Eid, Nancy
منشور في: (2010)

HySim: A Hybrid Software/Hardware Simulation Framework for Early Architectural Exploration of Chip Multiprocessors
حسب: unknown
منشور في: (2020)

An Efficient Network-on-Chip Architecture Based on the Fat-Tree (FT) Topology
حسب: Bouhraoua, A.
منشور في: (2006)

Methods for system-on-chip test design, scheduling and optimization. (c2006)
حسب: Farah, Rana
منشور في: (2006)

A geometric-primitives-based compression scheme for testingsystems-on-a-chip
حسب: El-Maleh, A.
منشور في: (2001)

A Geometric-Primitives-Based Compression Scheme for Testing Systems-on-a-Chip
حسب: El-Maleh, Aiman H.
منشور في: (2001)

AN ON CHIP ALL-DIGITAL CONFIGURABLE CLOCK GENERATOR FOR ASICS' AT-SPEED TESTING
حسب: unknown
منشور في: (2020)

VLSI LAYOUT GENERATION OF A PROGRAMMABLE CRC CHIP
حسب: Sait, Sadiq M.
منشور في: (2020)

VLSI layout generation of a programmable CRC chip
حسب: Sait, Sadiq M.
منشور في: (1993)

A Simulated Annealing Algorithm for System-on-Chip Test Scheduling with, Power and Precedence Constraints
حسب: Harmanani, Haidar M.
منشور في: (2006)

Built-in self test logic for a histogrammer memory chip
حسب: Hamzah, Azzam Ahmad
منشور في: (1993)

A Two-dimensional geometric-shapes-based compression scheme for deterministic testing of systems-on-a-chip
حسب: Khan, Esam Ali Hasan
منشور في: (2001)

Hardware design and VLSI implementation of a byte-wise CRCgenerator chip
حسب: Sait, Sadiq M.
منشور في: (1995)

An optimal formulation for test scheduling network-on-chip using multiple clock rates
حسب: Harmanani, Haidar M.
منشور في: (2017)

HARDWARE DESIGN AND VLSI IMPLEMENTATION OF A BYTE-WISE CRC GENERATOR CHIP
حسب: Sait, Sadiq M.
منشور في: (2020)

A hybrid test compression technique for efficient testing of systems-on-a-chip
حسب: El-Maleh, A.H.
منشور في: (2003)

A Hybrid Test Compression Technique for Efficient Testing of Systems-on-a-Chip
حسب: El-Maleh, Aiman H.
منشور في: (2003)

Thermal-aware test scheduling using network-on-chip under multiple clock rates
حسب: Harmanani, Haidar M.
منشور في: (2013)

Fast SPICE-compatible simulation of low-power on-chip PWM DC–DC converters with improved ripple accuracy
حسب: Burcea, Florin
منشور في: (2019)

An effective solution to thermal-aware test scheduling on network-on-chip using multiple clock rates
حسب: Harmanani, Haidar
منشور في: (2017)

Test bus assignment, sizing, and partitioning for system-on-chip
حسب: Harmanani, Haidar M.
منشور في: (2007)

Chip Level Implementation of a Digital Radar System
حسب: Al-Alem, Yazan
منشور في: (2015)

Extended Frequency-Directed Run-Length Code with Improved Application to System-on-a-Chip Test Data Compression
حسب: El-Maleh, Aiman H.
منشور في: (2002)

A GUI-based artificial neural network simulator
حسب: Nasr, G.E.
منشور في: (2004)

A Chip-Level BSOR-based linear GSIC multiuser Detector for Long-Code CDMA Systems
حسب: Bentrcia, A.
منشور في: (2007)

Test time minimization for system-on-chip with test bus assignment and sizin
حسب: Harmanani, Haidar M.
منشور في: (2017)

On Power-Constrained System-on-chip Test Scheduling Using Precedence Relationships
حسب: Harmanani, Haidar M.
منشور في: (2017)

Comment on Floating inductance simulation based on currentconveyors
حسب: Abuelma’atti, M.T.
منشور في: (1998)

Analysis and Simulation of Interrupt Overhead Impact on OS Throughput in High-Speed Networks
حسب: Salah, Khaled
منشور في: (2005)

Adaptive Chip-Level Channel Estimation for IMT-DS System: DL and UL
حسب: SHEIKH, ASRAR
منشور في: (2005)

A method for optimizing test bus assignment and sizing for system-on-a-chip
حسب: Harmanani, Haidar M.
منشور في: (2017)

Development of a cancer metastasis-on-chip assay for high throughput drug screening
حسب: Lutfiye Yildiz Ozer (17732619)
منشور في: (2024)

An OPNET-based Simulation Approach for Deploying VoIP
حسب: Salah, Khaled
منشور في: (2006)

Topology design of switched enterprise networks using a fuzzy simulated evolution algorithm
حسب: Youssef, H.
منشور في: (2020)

Topology design of switched enterprise networks using a fuzzy simulated evolution algorithm
حسب: Youssef, H.
منشور في: (2020)

A Portable Clock Recovery Circuit (CRC) For Systems-On-Chip Serial Data Communication
حسب: Elrabaa, Muhammad
منشور في: (2006)

A Digital Clock Re-Timing Circuit for On-Chip Source-Synchronous Serial Links
حسب: Elrabaa, Muhammad
منشور في: (2006)

Power-constrained system-on-a-chip test scheduling using a genetic algorithm
حسب: Harmanani, Haidar M.
منشور في: (2006)

Minimizing Broadcast Traffic in SDN-Based Switching Networks.
حسب: unknown
منشور في: (2020)

Cannot write session to /tmp/vufind_sessions/sess_2g2qc4rmpsgls5dmb905o43nbs